cpld用什么语言编程（cpld开发语言）

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本文目录一览：

• 1、VHDL语言对于CPLD的编程
• 2、初学可编程IC,是选择FPGA还是CPLD?语言是选择VHDL还是Verilog?_百度...
• 3、请问VHDL语言都可以给CPLD和FPGA编程么,CPLD和FPGA哪个用的广??
• 4、CPLD和FPGA的区别,用语言和逻辑图形设计有什么区别?
• 5、计算机硬件描述语言(VHDL)与编程语言(C语言)的区别及关系,
• 6、学习CPLD用vhdl和verilog哪种语言好

VHDL语言对于CPLD的编程

设计用一片CPLD/fpga，模数转换控制器ADC和LED显示器构成一个数据***集系统，用CPLD/FPGA实现数据***集中对A/D 转换，数据运算，及有关数据的显示控制。课题除了学习相应的硬件知识外，还要学习如何使用VHDL语言设计可编程逻辑器件。

实现CPLD全数字锁相环，用vhdl语言编写 80 设计一个基于CPLD的全数字锁相环，完成对触发频率的跟踪和相位的锁定功能，使输出迅速跟踪输入。而且需要实现两种情况下的锁定，90°锁定与0°锁定。

尽管FPGA和CPLD都是可编程ASIC器件，有很多共同特点，但由于CPLD和FPGA结构上的差异，具有各自的特点：①CPLD更适合完成各种算法和组合逻辑，FP GA更适合于完成时序逻辑。

VHDL，verilog是FPGA（或cpld）的编程语言。着两种都是硬件编程语言，也就是对硬件进行逻辑综合编程。单片机是“已知硬件”，也就是说硬件都已经设计好了，需要做得是软件编程，一般是用C或汇编。

初学可编程IC,是选择FPGA还是CPLD?语言是选择VHDL还是Verilog?_百度...

FPGA比CPLD先进些，不过他们的编程都是一样的用的是硬件描述语言，一般还是选用VHDL语言较好，比起其他的硬件语言，如veilog hdl，有更好的应变能力，适应较大程序的编写。

FPGA是你要用到的工具，而Verilog是你在使用FPGA时所运用语言。

但容易入手；verilog的话相对比较灵活，适合大型开发，但是在编译时比不上VHDL。现在来说，学校教学一般使用VHDL，但是公司用的多的还是verilog。建议初学者使用VHDL，学到一种严谨的习惯，再学verilog就相对简单。

VHDL、AHDL和Verilog HDL 是硬件描述语言，通常用于FPGA/CPLD的设计。初学者选择Verilog HDL比较容易上手，而且和C语言的语法比较接近，也比较通用。VHDL更常用于大型项目、军工等。AHDL使用的较少、不通用，故不建议学习。

请问VHDL语言都可以给CPLD和FPGA编程么,CPLD和FPGA哪个用的广??

1、不是的。无论***用哪种PLD来实现硬件设计，都与描述语言无关。设计者会按照自己的设计习惯，决定***用VHDL还是Verilog HDL来描述设计。

2、CPLD/FPGA 和 单片机是不同的。VHDL，verilog是FPGA（或cpld）的编程语言。着两种都是硬件编程语言，也就是对硬件进行逻辑综合编程。

3、逻辑结构不同 CPLD类似PAL、GAL，拥有丰富的组合逻辑电路***。FPGA：类似门阵列，拥有丰富的触发器、存储器***；CPU、DSP等IP核。集成度不同 CPLD：500~50000门；CPLD：500~50000门；FPGA：1K~10M门。

4、，作用不同。CPLD一般用来做胶合逻辑，而FPGA可以实现很复杂的功能，从DSP运算到内嵌式CPU到高速串行接口，理论上你可以想到的数字电路都可以实现。VHDL是一种语言，不是器件。

5、vhdl是一种硬件描述语言，fpga指的是可编程芯片。vhdl：very-high-speed integrated circuit hardware description language，诞生于1982年。

CPLD和FPGA的区别,用语言和逻辑图形设计有什么区别?

cpld和fpga的区别在于逻辑结构不同、集成度不同、互连结构不同、粒度大小不同、应用范围的不同。逻辑结构不同 CPLD类似PAL、GAL，拥有丰富的组合逻辑电路***。

FPGA器件和CPLD器件的区别是从CPLD器件发展到FPGA器件，并不仪仅是规模和集成度的进一步提升，而是FPGA器件的体系结构远远复杂于CPLD器件。CPLD器件更适合于实现具有更多的组合电路，而寄存器数目受限的简单设计。

FPGA和CPLD的区别：①CPLD更适合完成各种算法和组合逻辑，FPGA更适合于完成时序逻辑。换句话说，FPGA更适合于触发器丰富的结构，而CPLD更适合于触发器有限而乘积项丰富的结构。

CPLD和FPGA的主要区别是他们的系统结构。CPLD是一个有点限制性的结构。这个结构由一个或者多个可编辑的结果之和的逻辑组列和一些相对少量的锁定的寄存器。

计算机硬件描述语言(VHDL)与编程语言(C语言)的区别及关系,

首先说VHDL：它是描述电路的计算机工具，早期的CPLD等器件是基于与-或阵列的，更容易说明这点，VHDL是描述电路行为的，当下载到器件后，它就是具体的电路，这个电路全由与-或阵列组成。

VHDL是硬件描述语言，用来做硬件设计的；C语言是软件编程语言，用来编写软件程序的。一个是用来设计硬件系统的，一个是用来设计软件系统的，用途完全不同，不可同日而语。

两个语言没有什么联系。前者是面向硬件的，有点类似单片机。一个是面向软件的，是计算机编程。语法结构没什么大的相似。都是编程语言。如果你要制造一个定时***的定时系统，VHDL适合。

定义：Verilog是用于模拟电子系统的硬件描述语言（HDL），而C是允许结构化编程的通用编程语 言。因此，这是Verilog和C之间的主要区别。

汇编属底层需要。编写时间长工作量大，底层开发驱动开发。C可以适用于大部分开发。vhdl集成电路硬件描述语言，主要是应用在数字电路的设计中。他们的应用环境不同。

学习CPLD用vhdl和verilog哪种语言好

VHDL 源于军方的ADA编程，而verilog则源于[_a***_]熟悉的C语言。所以，学verilog入门较快，快的话几天就可以掌握全部语法。当然只是理解和懂得，灵活的运用还要依靠大量的实践。而相对来说VHDL入门则比较难。

学习FPGA选择VHDL或者verilog HDL。其实两种语言的差别并不大，他们的描述能力也是类似的。掌握其中一种语言以后，可以通过短期的学习，较快的学会另一种语言。

在中国企业中用的verilog hdl是最多的，在学校可能用的VHDL多一些，VHDL偏向原语一些，verilog hdl有C语言的特征。

但容易入手；verilog的话相对比较灵活，适合大型开发，但是在编译时比不上VHDL。现在来说，学校教学一般使用VHDL，但是公司用的多的还是verilog。建议初学者使用VHDL，学到一种严谨的习惯，再学verilog就相对简单。

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